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高速シリアライザ／デシリアライザのために正確なクロック位相信号を生成するための回路
- 专利权人:
- クゥアルコム・インコーポレイテッドＱＵＡＬＣＯＭＭ ＩＮＣＯＲＰＯＲＡＴＥＤ
- 发明人:
- アルクディア、ケネース,チェン、ジキン
- 申请号：
- JP20160563429
- 公开号：
- JP6133523(B1)
- 申请日:
- 2015.03.11
- 申请国别(地区):
- 日本
- 年份:
- 2017
- 代理人:
- 摘要：
- 正確なタイミング関係性を有するクロック位相信号を生成するためのシステム及び方法が開示される。例えば、９０度離間されている４つのクロック信号が、差動ＣＭＬクロック信号から生成されることができる。ＣＭＬ／ＣＭＯＳ変換器は、差動ＣＭＬクロック信号を差動ＣＭＯＳクロック信号に変換し、デューティサイクル補正を提供する。遅延セルは、差動ＣＭＯＳクロック信号から遅延クロック信号を生成する。差動ＣＭＯＳクロック信号及び遅延クロック信号は、１／４クロック期間のアクティブ時間を有する４つのクォータクロック信号を生成するために、論理的に組み合わせられる。セット−リセットラッチは、クォータクロック信号から４つのクロック信号を生成する。較正モジュールは、４つのクロック信号のタイミング関係性を調整する
- 来源网站：
- 中国工程科技知识中心
- 来源网址：
- http://www.ckcest.cn/home/
