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INTERCARDIAC DEFIBRILLATION CATHETER SYSTEM
专利权人:
JAPAN LIFELINE CO.; LTD.;니혼라이프라인 가부시키가이샤;JAPAN LIFELINE CO., LTD.
发明人:
ONODERA YUTAKA,오노데라 유타카
申请号:
KR1020127023304
公开号:
KR1020120114401A
申请日:
2010.09.29
申请国别(地区):
KR
年份:
2012
代理人:
摘要:
Disclosed is an intercardiac defibrillation catheter system provided with a defibrillation catheter (100) and a power source device (700); wherein the defibrillation catheter (100) is provided with a memory (110) comprising an initial connection information storage unit (112) and an event information storage unit (113); and the power source device (700) is provided with an arithmetic processing unit (75) which comprises an output circuit (751) of direct current voltage, a memory (752) for storing a usage time limit, and an internal clock (753), and which controls writing to and reading from the memory (110) of the defibrillation catheter (100). The arithmetic processing unit (75), for each event that has been written to the event storage unit (113) of the memory (110) of the defibrillation catheter (100), performs control so that the next event is not executed if the elapsed time between the connection time that has been written to the initial connection information storage unit (112) of the memory (110) of the defibrillation catheter (100) and the time that the first-mentioned event has been performed has been determined to exceed the usage time limit.제세동 카테터 (100) 와 전원 장치 (700) 를 구비하고 ; 제세동 카테터 (100) 는, 첫회 접속 정보 기억부 (112) 및 이벤트 정보 기억부 (113) 를 갖는 메모리 (110) 를 구비하여 이루어지고 ; 전원 장치 (700) 는, 직류 전압의 출력 회로 (751), 사용 제한 시간을 기억하는 메모리 (752), 내부 시계 (753) 를 갖고, 제세동 카테터 (100) 의 메모리 (110) 에 대한 기록 및 판독 출력을 제어하는 연산 처리부 (75) 를 구비하여 이루어지고 ; 연산 처리부 (75) 는, 제세동 카테터 (100) 의 메모리 (110) 의 이벤트 기억부 (113) 에 기록된 이벤트마다, 제세동 카테터 (100) 의 메모리 (110) 의 첫회 접속 정보 기억부 (112) 에 기록된 접속 시각부터, 그 이벤트가 실시된 시각까지의 경과 시간이, 사용 제한 시간을 초과하였다고 판단한 경우에는, 다음의 이벤트를 실행시키지 않도록 제어하는, 심강 내 제세동 카테터 시스템이다.
来源网站:
中国工程科技知识中心
来源网址:
http://www.ckcest.cn/home/
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